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DSPIC30F5011-30I/PT

Pequena descrição:

• Arquitetura de Harvard modificada
• Arquitetura do conjunto de instruções otimizadas do compilador C
• Modos de endereçamento flexíveis
• 83 instruções básicas
• Instruções de 24 bits, caminho de dados de 16 bits
• 66 Kbytes de espaço de programa Flash no chip


Detalhes do produto

Etiquetas de produtos

Características CPU RISC modificada de alto desempenho

1.Arquitetura de Harvard modificada
Arquitetura do conjunto de instruções otimizadas do compilador 2.C
3. Modos de endereçamento flexíveis
4.83 instruções básicas
Instruções de largura de 5,24 bits, caminho de dados de largura de 16 bits
Espaço de programa Flash no chip de 6,66 Kbytes
7,4 Kbytes de RAM de dados no chip
8,1 Kbytes de dados não voláteis EEPROM
Matriz de registro de trabalho de 9,16 x 16 bits
10. Operação de até 30 MIPS:
- Entrada de clock externo DC a 40 MHz
- Entrada de oscilador de 4 MHz-10 MHz com
PLL ativo (4x, 8x, 16x)

Até 41 fontes de interrupção

- Oito níveis de prioridade selecionáveis ​​pelo usuário
- Cinco fontes externas de interrupção
- Quatro armadilhas do processador

Recursos do DSP

1. Busca dupla de dados
2. Modos Modulo e Bit-Invertido
3.Dois acumuladores de largura de 40 bits com opcional
lógica de saturação
Hardware de ciclo único de 4,17 bits x 17 bits fracionário/
multiplicador inteiro
5. Todas as instruções DSP são de ciclo único
- Operação Multiplicar-Acumular (MAC)
6. Ciclo único ± 16 turnos

Recursos Periféricos

1. Pinos de E/S de dissipador/fonte de alta corrente: 25 mA/25 mA
2. Cinco temporizadores/contadores de 16 bits;emparelhar opcionalmente
Temporizadores de 16 bits em módulos de temporizadores de 32 bits
Funções de entrada de captura de 3,16 bits
Funções de saída de comparação/PWM de 4,16 bits
5.Data Converter Interface (DCI) suporta comum
protocolos de codec de áudio, incluindo I2S e AC'97
Módulos SPI de 6,3 fios (suporta quatro modos Frame)
7. O módulo I2C™ suporta o modo Multi-Master/Slave
e endereçamento de 7 bits/10 bits
8.Dois módulos UART endereçáveis ​​com buffers FIFO
9.Dois módulos de barramento CAN compatíveis com o padrão CAN 2.0B

Recursos analógicos

Conversor analógico-digital (ADC) de 1,12 bits com:
- Taxa de conversão de 200 ksps
- Até 16 canais de entrada
- Conversão disponível durante o sono e ocioso
2.Detecção de baixa tensão programável (PLVD)
3. Detecção de brown-out programável e geração de reset
Recursos especiais do microcontrolador:
4.Memória do programa Flash aprimorada:
- 10.000 ciclos de apagamento/gravação (min.) para faixa de temperatura industrial, 100K (típico)
5.Memória EEPROM de dados:
- 100.000 ciclos de apagamento/gravação (min.) para faixa de temperatura industrial, 1M (típico)
6.Auto-reprogramável sob controle de software
7. Power-on Reset (POR), Power-up Timer (PWRT) e Oscillator Start-up Timer (OST)
8. Temporizador flexível de Watchdog (WDT) com oscilador RC de baixa potência no chip para operação confiável
9. Operação do monitor de relógio à prova de falhas:
- Detecta falha de clock e alterna para o oscilador RC de baixa potência no chip
Proteção de código programável:
10. Capacidade de programação In-Circuit Serial Programming™ (ICSP™)
11.Modos de gerenciamento de energia selecionáveis:
- Modos de suspensão, ocioso e relógio alternativo
Tecnologia CMOS:
12. Tecnologia Flash de baixa potência e alta velocidade
13. Ampla faixa de tensão operacional (2,5 V a 5,5 V)
14.Faixas de temperatura industriais e estendidas
15.Baixo consumo de energia


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